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neue FPGA-Miner?
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Topic: neue FPGA-Miner? (Read 1512 times)
Bytekiller
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neue FPGA-Miner?
June 12, 2013, 01:00:52 PM
#1
Gibts eigentlich FPGA-Miner mit neueren/leistungsfähigeren Chips als die Spartan-6?
Hab küzlich bei jemand eine PCI-Karte mit zwei Virtex7 eingebaut.
gruss
Als ich jung war, waren alle Glieder gelenkig - bis auf eins. Als ich älter wurde, waren alle Glieder steif - bis auf eins.
OnkelPaul
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Re: neue FPGA-Miner?
June 12, 2013, 01:04:37 PM
#2
Kann man machen, lohnt aber für das Hashing-Ergebnis vermutlich den Aufwand nicht gegenüber ASIC-Minern.
Wenn man sowieso verschiedene Dinge mit FPGAs machen will und sie deswegen schon hat, ist es natürlich nett, sie mal ein paar Bitcoins verdienen zu lassen.
Onkel Paul
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Bytekiller
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Re: neue FPGA-Miner?
June 12, 2013, 01:25:56 PM
#3
das Teil erstellt belichterdaten für einen Heidelberg belichter
da kann man nicht so einfach mal bitcoins dauf laufen lassen
Als ich jung war, waren alle Glieder gelenkig - bis auf eins. Als ich älter wurde, waren alle Glieder steif - bis auf eins.
TheOtherOne
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Re: neue FPGA-Miner?
June 20, 2013, 04:54:41 PM
#4
Ein Virtex 6 (240er) kommt auf ~3 Gh.
http://www.digikey.com/product-detail/en/XC6VLX240T-1FFG1156C/122-1679-ND/2408289
Insofern ist deine Virtex 7, je nach Modell schon SEHR brauchbar.
Leider nur nicht günstig genug, Hier das kleinste Modell
http://www.digikey.com/product-detail/en/XC7VX330T-1FFG1157C/XC7VX330T-1FFG1157C-ND/3925287
badalien
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Re: neue FPGA-Miner?
June 20, 2013, 05:40:41 PM
#5
was denn wenn man so ein fpga board in der Hand hält, heißt dann "in hand" :-)
Muss dann extra SW geschrieben werden, bitstream etc oder kann man was flashen was es schon gibt, ich bin in der Richtung Chip Coding nen dau frage aber trotzdem.
TheOtherOne
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Re: neue FPGA-Miner?
June 20, 2013, 06:23:12 PM
#6
Ja, der Bitstream muss in der Regel aus dem FPGA specifischen Schema neu erstellt oder zumindest angepasst werden.
Flashen reicht nicht, zumindest nach meinem derzeitigen Wissenstand. Bin zwar auch Coder aber kein VHDL/Verilog(er).
In China haben einige Entwickler mit einem Virtex 6 Evaluation Board und einem angepassten Icarus Schema 3 Gh Raw
für SHA256 erreicht. Ziel ist es eine ausreichend schnelle Anbindung an günstigen Speicher/DDR3 zu Evaluieren um LTC
mit FPGAs zu minen. Sieht momentan aber nicht so gut aus.
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